[an error occurred while processing this directive]
|
Задержка сигналов относительно защелкивающего клока получается
dTclk2adc + dTadc + dTdata2fpga, т.е. эквивалентная длинна больше 20 сантиметров. Защелкивать входные данные надо по выровненному с данными клоку. Подвигайте его относительно данных.
Еще, не знаю как в SpartanII, но в современных FPGA есть опция Fast Input register - т.е. для фиксации данных используется регистер, встроенный в IOB, а не обычный из LE.
E-mail: info@telesys.ru