[an error occurred while processing this directive]
|
буду разбираться...
про систему - PLL на АЦП, через /2 на ПЛИС (может даже /4 - если АЦП с демуксом), там восстанавливается фазность/скважность (собственно это я назвал "виртуальным клоком")
наверно на каждый порт надо свою DCM (это управляемая задержка в Xilinx) ставить, хотя может и одной обойтись - на плате скомпенсировать
E-mail: info@telesys.ru