[an error occurred while processing this directive]
|
все температурные и эффекты питания компенсируються с помощью DLL, ячейки которой топологически расположены рядом с TDC (time to digital) структурой. На FPGA получаеться плохо - неизвестна топология. Лучше всего по повторяемости было на внешней CPLD и управлять ее напряжением питания ( в пределах допустимого)
E-mail: info@telesys.ru