|
Прошу подсказать. Quartus разрешает подключать сигнал по стандарту
LVDS к ножке "p"(плюсовая) пары и не разрешает подключать к ножке "n". Как устроен приемник LVDS, сколько I\O ячеек он занимает?
Задача состоит в том, чтобы один сигнал в уровнях LVDS частотй 250 МГц записать в два быстрых регистра (в I\O ячейки прямым и инверсным значением) с целью понизить частоту для дальнейшей записи сигнала в память. Возможно ли такое?. Речь идет о Циклоне-2.