[an error occurred while processing this directive]
моя идея была переложить эту функцию из VHDL в Verilog, есть ещё Verilog-A для аналоговой схемоты, там logarithm стандартная функция, банальная мысль: почему в обычный не заложили эту функцию? Если кто че придумает, ДЕЛИТЕСЬ :)
(«Телесистемы»: Конференция «Языки описания аппаратуры (VHDL и др.))