[an error occurred while processing this directive]
|
В нете был пример использующий это:
для HDL Synthesis Xilinx ISE 6.x XST VHDL\Verilog
Implementation Xilinx ISE 6.x.
Я первоначально пробовал Xilinx ISE Synthesis&Implementation он у меня не хотел че либо делать даже синтез не проходил. А после копания в нете когда применил настройки (выше), то все заработало, еще в опциях правда не доконца разобрался(, но это дело техники и времени).
E-mail: info@telesys.ru