[an error occurred while processing this directive]
Ответ: При временном моделированнии в backannotated VHDL-файле по умолчанию присутствует блочок ROC, формирующий сигнал глобального сброса длительностью 100 ns ...
(«Телесистемы»: Конференция «Программируемые логические схемы и их применение»)
Отправлено
Vasilij 18 октября 2004 г. 11:19
В ответ на: Вопрос по Active-HDL отправлено
Figaro 18 октября 2004 г. 10:07
Обычно я эту задержку исправлял прямо в этом же файле. (Для разводки использовал Xilinx Foundation)